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1.1 ! root 1: 1 00000000 # 1 "" ! 2: 1 00000000 ! 3: 2 00000000 ! 4: 3 00000000 ! 5: 4 00000000 ! 6: 5 00000000 ! 7: 6 00000000 .set SBR,0 ! 8: 7 00000000 .set SLR,1 ! 9: 8 00000000 .set P0BR,2 ! 10: 9 00000000 .set P0LR,3 ! 11: 10 00000000 .set P1BR,4 ! 12: 11 00000000 .set P1LR,5 ! 13: 12 00000000 .set P2BR,6 ! 14: 13 00000000 .set P2LR,7 ! 15: 14 00000000 .set IPL,8 ! 16: 15 00000000 .set MME,9 ! 17: 16 00000000 .set TBIA,10 ! 18: 17 00000000 ! 19: 18 00000000 .set TBIS,11 ! 20: 19 00000000 ! 21: 20 00000000 .set DCK,12 ! 22: 21 00000000 .set CCK,13 ! 23: 22 00000000 .set PCBB,14 ! 24: 23 00000000 .set ISP,15 ! 25: 24 00000000 .set SIRR,16 ! 26: 25 00000000 .set SISR,17 ! 27: 26 00000000 .set SCBB,18 ! 28: 27 00000000 .set KSP,19 ! 29: 28 00000000 .set USP,20 ! 30: 29 00000000 .set DCB,21 ! 31: 30 00000000 .set PACC,23 ! 32: 31 00000000 ! 33: 32 00000000 .set P1DC,24 ! 34: 33 00000000 .set PADC,25 ! 35: 34 00000000 ! 36: 35 00000000 .set HISR,26 ! 37: 36 00000000 .set DCR,27 ! 38: 37 00000000 .set PDCS,28 ! 39: 38 00000000 ! 40: 39 00000000 ! 41: 40 00000000 #TAHOE program status longword ! 42: 41 00000000 ! 43: 42 00000000 ! 44: 43 00000000 .set PSL_C,0x00000001 ! 45: 44 00000000 .set PSL_V,0x00000002 ! 46: 45 00000000 .set PSL_Z,0x00000004 ! 47: 46 00000000 .set Z,0x00000004 ! 48: 47 00000000 .set PSL_N,0x00000008 ! 49: 48 00000000 .set PSL_T,0x00000010 ! 50: 49 00000000 .set PSL_I,0x00000020 ! 51: 50 00000000 .set PSL_EN_OVFL,0x20 ! 52: 51 00000000 .set PSL_EN_UNDFL,0x40 ! 53: 52 00000000 .set PSL_DBL,0x80 ! 54: 53 00000000 .set PSL_IPL,0x001f0000 ! 55: 54 00000000 .set PSL_MOD,0x01000000 ! 56: 55 00000000 .set PSL_IS,0x04000000 ! 57: 56 00000000 .set PSL_TP,0x40000000 ! 58: 57 00000000 ! 59: 58 00000000 ! 60: 59 00000000 # TAHOE page table entry ! 61: 60 00000000 #/ ! 62: 61 00000000 .set PG_V,0x8000000 ! 63: 62 00000000 .set PG_PROT,0x78000000 ! 64: 63 00000000 .set PG_M,0x04000000 ! 65: 64 00000000 .set PG_USED,0x02000000 ! 66: 65 00000000 .set PG_NC,0x01000000 ! 67: 66 00000000 .set PG_PFNUM,0x003fffff ! 68: 67 00000000 ! 69: 68 00000000 .set PG_NOACC,0 ! 70: 69 00000000 .set PG_KR,0x40000000 ! 71: 70 00000000 .set PG_KW,0x60000000 ! 72: 71 00000000 .set PG_URKR,0x50000000 ! 73: 72 00000000 .set PG_URKW,0x70000000 ! 74: 73 00000000 .set PG_UW,0x78000000 ! 75: 74 00000000 ! 76: 75 00000000 #* PCB offsets & diagnostic extension to pcb */ ! 77: 76 00000000 #* PCB is at pcb0 */ ! 78: 77 00000000 ! 79: 78 00000000 ! 80: 79 00000000 .set PCB_SIZE, 24 ! 81: 80 00000000 .set PCB_KSP, 0 ! 82: 81 00000000 .set PCB_USP, 4 ! 83: 82 00000000 .set PCB_R0, 8 ! 84: 83 00000000 .set PCB_R1, 12 ! 85: 84 00000000 .set PCB_R2, 16 ! 86: 85 00000000 .set PCB_R3, 20 ! 87: 86 00000000 .set PCB_R4, 24 ! 88: 87 00000000 .set PCB_R5, 28 ! 89: 88 00000000 .set PCB_R6, 32 ! 90: 89 00000000 .set PCB_R7, 36 ! 91: 90 00000000 .set PCB_R8, 40 ! 92: 91 00000000 .set PCB_R9, 44 ! 93: 92 00000000 .set PCB_R10, 48 ! 94: 93 00000000 .set PCB_R11, 52 ! 95: 94 00000000 .set PCB_R12, 56 ! 96: 95 00000000 .set PCB_R13, 60 ! 97: 96 00000000 .set PCB_PC, 64 ! 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128: 127 00000000 #* SCB is at scb */ ! 129: 128 00000000 ! 130: 129 00000000 .set PFVEC,1*4 ! 131: 130 00000000 .set PRVEC,2*4 ! 132: 131 00000000 .set CLOCKVEC,7*4 ! 133: 132 00000000 .set CRVEC,0xa*4 ! 134: 133 00000000 .set CXVEC,44 ! 135: 134 00000000 .set SIVEC1,0x1e*4 ! 136: 135 00000000 ! 137: 136 00000000 ! 138: 137 00000000 .set BEVEC,0x20*4 ! 139: 138 00000000 .set SYSVEC,0x2b*4 ! 140: 139 00000000 .set PINSTVEC,0x2c*4 ! 141: 140 00000000 .set PRIVSVEC,0x2c*4 ! 142: 141 00000000 .set ROVEC,0x2d*4 ! 143: 142 00000000 .set RAVEC,0x2e*4 ! 144: 143 00000000 .set PROTVEC,0x2f*4 ! 145: 144 00000000 .set TRANS,0x30 ! 146: 145 00000000 .set TRANSVEC,0x30*4 ! 147: 146 00000000 .set KSPVEC,0x31*4 ! 148: 147 00000000 .set TRACEVEC,0x32*4 ! 149: 148 00000000 .set BPTVEC,0x33*4 ! 150: 149 00000000 .set ARITHVEC,0x34*4 ! 151: 150 00000000 .set ALIGNVEC,0x35*4 ! 152: 151 00000000 .set FPMVEC,0x37*4 ! 153: 152 00000000 .set IO14VEC,256 ! 154: 153 00000000 .set IO15VEC,320 ! 155: 154 00000000 .set IO16VEC,384 ! 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215: 214 00000000 .set ARITHTRAP,6 ! 216: 215 00000000 .set PROTFLT,7 ! 217: 216 00000000 .set TRCTRAP,8 ! 218: 217 00000000 .set TRANSFLT,9 ! 219: 218 00000000 .set DONE,255 ! 220: 219 00000000 ! 221: 220 00000000 ! 222: 221 00000000 # Event codes ! 223: 222 00000000 ! 224: 223 00000000 .set RTCLOCK_CODE,7 ! 225: 224 00000000 .set RESOP_CODE,0x2d ! 226: 225 00000000 .set RESAD_CODE,0x2e ! 227: 226 00000000 .set ARITH_CODE,0x34 ! 228: 227 00000000 .set FPM_CODE,0x37 ! 229: 228 00000000 .set INTEGER_OVERFLOW,1 ! 230: 229 00000000 ! 231: 230 00000000 ! 232: 231 00000000 # Arithmetic Event types ! 233: 232 00000000 ! 234: 233 00000000 .set INT_OVFL_CODE,1 ! 235: 234 00000000 .set INT_0_DIV_CODE,2 ! 236: 235 00000000 .set FLT_0_DIV_CODE,3 ! 237: 236 00000000 .set FLT_OVFL_CODE,4 ! 238: 237 00000000 .set FLT_UNDFL_CODE,5 ! 239: 238 00000000 ! 240: 239 00000000 ! 241: 240 00000000 # Floating Point Instruction Op-Codes ! 242: 241 00000000 ! 243: 242 00000000 .set LDF_OP_CODE,0x06 ! 244: 243 00000000 .set LDD_OP_CODE,0x07 ! 245: 244 00000000 .set LNF_OP_CODE,0x16 ! 246: 245 00000000 .set LND_OP_CODE,0x17 ! 247: 246 00000000 .set STF_OP_CODE,0x26 ! 248: 247 00000000 .set STD_OP_CODE,0x27 ! 249: 248 00000000 .set CMPF_OP_CODE,0x36 ! 250: 249 00000000 .set CMPD_OP_CODE,0x37 ! 251: 250 00000000 .set CMPF2_OP_CODE,0x46 ! 252: 251 00000000 .set CMPD2_OP_CODE,0x47 ! 253: 252 00000000 .set TSTF_OP_CODE,0x56 ! 254: 253 00000000 .set TSTD_OP_CODE,0x57 ! 255: 254 00000000 .set PUSHD_OP_CODE,0x67 ! 256: 255 00000000 .set CVLF_OP_CODE,0x76 ! 257: 256 00000000 .set CVLD_OP_CODE,0x77 ! 258: 257 00000000 .set CVFL_OP_CODE,0x86 ! 259: 258 00000000 .set CVDL_OP_CODE,0x87 ! 260: 259 00000000 .set LDFD_OP_CODE,0x97 ! 261: 260 00000000 .set CVDF_OP_CODE,0xa6 ! 262: 261 00000000 .set NEGF_OP_CODE,0xb6 ! 263: 262 00000000 .set NEGD_OP_CODE,0xb7 ! 264: 263 00000000 .set ADDF_OP_CODE,0xc6 ! 265: 264 00000000 .set ADDD_OP_CODE,0xc7 ! 266: 265 00000000 .set SUBF_OP_CODE,0xd6 ! 267: 266 00000000 .set SUBD_OP_CODE,0xd7 ! 268: 267 00000000 .set MULF_OP_CODE,0xe6 ! 269: 268 00000000 .set MULD_OP_CODE,0xe7 ! 270: 269 00000000 .set DIVF_OP_CODE,0xf6 ! 271: 270 00000000 .set DIVD_OP_CODE,0xf7 ! 272: 271 00000000 .set SINF_OP_CODE,0x05 ! 273: 272 00000000 .set COSF_OP_CODE,0x15 ! 274: 273 00000000 .set ATANF_OP_CODE,0x25 ! 275: 274 00000000 .set LOGF_OP_CODE,0x35 ! 276: 275 00000000 .set SQRTF_OP_CODE,0x45 ! 277: 276 00000000 .set EXPF_OP_CODE,0x55 ! 278: 277 00000000 .set MULL2_OP_CODE,0x4c ! 279: 278 00000000 .set MULL3_OP_CODE,0x5c ! 280: 279 00000000 ! 281: 280 00000000 ! 282: 281 00000000 ! 283: 282 00000000 # Addressing test constants - These must agree with "fpp_defs.h" ! 284: 283 00000000 ! 285: 284 00000000 .set ADR_ABSOLUTE,1 ! 286: 285 00000000 .set ADR_LITERAL,2 ! 287: 286 00000000 .set ADR_IM_B,3 ! 288: 287 00000000 .set ADR_IM_W,4 ! 289: 288 00000000 .set ADR_IM_L,5 ! 290: 289 00000000 .set ADR_B_DSP,6 ! 291: 290 00000000 .set ADR_W_DSP,7 ! 292: 291 00000000 .set ADR_L_DSP,8 ! 293: 292 00000000 .set ADR_B_DSP_DEF,9 ! 294: 293 00000000 .set ADR_W_DSP_DEF,10 ! 295: 294 00000000 .set ADR_L_DSP_DEF,11 ! 296: 295 00000000 .set ADR_REG,12 ! 297: 296 00000000 .set ADR_REG_DEF,13 ! 298: 297 00000000 .set ADR_FP_DEF,14 ! 299: 298 00000000 .set ADR_SP_DEF,15 ! 300: 299 00000000 .set ADR_PUSH,16 ! 301: 300 00000000 .set ADR_POP,17 ! 302: 301 00000000 .set ADR_POP_DEF,18 ! 303: 302 00000000 .set ADR_REG_B,19 ! 304: 303 00000000 .set ADR_REG_W,20 ! 305: 304 00000000 .set ADR_REG_L,21 ! 306: 305 00000000 .set ADR_REG_B_DEF,22 ! 307: 306 00000000 .set ADR_REG_W_DEF,23 ! 308: 307 00000000 .set ADR_REG_L_DEF,24 ! 309: 308 00000000 .set ADR_I_FP_DEF,25 ! 310: 309 00000000 .set ADR_I_L,26 ! 311: 310 00000000 ! 312: 311 00000000 ! 313: 312 00000000 #************************************************************************* ! 314: 313 00000000 ! 315: 314 00000000 # Stuff for the Demand Paging , Events, & Addressing Tests ! 316: 315 00000000 ! 317: 316 00000000 #************************************************************************/ ! 318: 317 00000000 .set SGL,1 ! 319: 318 00000000 .set DBL,2 ! 320: 319 00000000 .set ENABLE_EVENTS,0x60 ! 321: 320 00000000 .set NONE,0 ! 322: 321 00000000 .set LOAD,1 ! 323: 322 00000000 .set STORE,2 ! 324: 323 00000000 ! 325: 324 00000000 .set NO_EVT_HLT,1 ! 326: 325 00000000 .set EVT_MSK_HLT,2 ! 327: 326 00000000 .set BAD_PSL_HLT,3 ! 328: 327 00000000 .set PUSH_CNT_HLT,4 ! 329: 328 00000000 .set PUSH_PSL_HLT,5 ! 330: 329 00000000 .set PUSH_PC_HLT,6 ! 331: 330 00000000 .set BAD_REG_HLT,7 ! 332: 331 00000000 .set BAD_ACC_HLT,8 ! 333: 332 00000000 ! 334: 333 00000000 ! 335: 334 00000000 # set DMP_PG_0 to the 1st empty page ! 336: 335 00000000 ! 337: 336 00000000 .set DMP_PG_0,0x36000 ! 338: 337 00000000 .set DMP_PG_1,DMP_PG_0+0x400 ! 339: 338 00000000 .set DMP_PG_2,DMP_PG_1+0x400 ! 340: 339 00000000 .set DMP_PG_3,DMP_PG_2+0x400 ! 341: 340 00000000 .set DMP_PG_4,DMP_PG_3+0x400 ! 342: 341 00000000 .set DMP_PG_5,DMP_PG_4+0x400 ! 343: 342 00000000 .set DMP_PG_6,DMP_PG_5+0x400 ! 344: 343 00000000 .set DMP_PG_7,DMP_PG_6+0x400 ! 345: 344 00000000 .set DMP_PG_8,DMP_PG_7+0x400 ! 346: 345 00000000 .set DMP_PG_9,DMP_PG_8+0x400 ! 347: 346 00000000 .set DMP_PG_10,DMP_PG_9+0x400 ! 348: 347 00000000 .set DMP_PG_11,DMP_PG_10+0x400 ! 349: 348 00000000 .set DMP_PG_12,DMP_PG_11+0x400 ! 350: 349 00000000 .set DMP_PG_13,DMP_PG_12+0x400 ! 351: 350 00000000 ! 352: 351 00000000 ! 353: 352 00000000 # test code space for the address / demand page tests ! 354: 353 00000000 ! 355: 354 00000000 .set START_OF_CODE,DMP_PG_1-20 ! 356: 355 00000000 .set CODE_BUF_SIZE,40 ! 357: 356 00000000 .set END_OF_CODE,START_OF_CODE+CODE_BUF_SIZE ! 358: 357 00000000 ! 359: 358 00000000 ! 360: 359 00000000 # data locations used by the event and demand page tests ! 361: 360 00000000 ! 362: 361 00000000 .set _dmp_byte_op_1,DMP_PG_1+0x40 ! 363: 362 00000000 .set _dmp_byte_op_2,DMP_PG_1+0x60 ! 364: 363 00000000 .set _dmp_byte_op_3,DMP_PG_1+0x80 ! 365: 364 00000000 .set _dmp_op_1,DMP_PG_3-4 ! 366: 365 00000000 .set _dmp_op_1_ptr,DMP_PG_4+0x30 ! 367: 366 00000000 .set _dmp_op_2_ptr,DMP_PG_5+0x30 ! 368: 367 00000000 .set _dmp_op_2,DMP_PG_7-4 ! 369: 368 00000000 .set _dmp_op_3,DMP_PG_8 ! 370: 369 00000000 .set _dmp_op_3_ptr,DMP_PG_9+0x30 ! 371: 370 00000000 .set _dmp_op_4,DMP_PG_10 ! 372: 371 00000000 .set _dmp_op_5,DMP_PG_11 ! 373: 372 00000000 .set _sp_minus,DMP_PG_13-4 ! 374: 373 00000000 .set _sp_page,DMP_PG_13 ! 375: 374 00000000 .set _sp_plus,DMP_PG_13+4 ! 376: 375 00000000 ! 377: 376 00000000 ! 378: 377 00000000 ! 379: 378 00000000 ! 380: 379 00000000 ! 381: 380 00000000 ! 382: 381 00000000 ! 383: 382 00000000 ! 384: 383 00000000 ! 385: 384 00000000 ! 386: 385 00000000 ! 387: 386 00000000 ! 388: 387 00000000 ! 389: 388 00000000 ! 390: 389 00000000 ! 391: 390 00000000 ! 392: 391 00000000 ! 393: 392 00000000 ! 394: 393 00000000 ! 395: 394 00000000 ! 396: 395 00000000 ! 397: 396 00000000 ! 398: 397 00000000 ! 399: 398 00000000 ! 400: 399 00000000 ! 401: 400 00000000 ! 402: 401 00000000 ! 403: 402 00000000 ! 404: 403 00000000 ! 405: 404 00000000 ! 406: 405 00000000 ! 407: 406 00000000 ! 408: 407 00000000 ! 409: 408 00000000 ! 410: 409 00000000 ! 411: 410 00000000 # 1 "./prvreg.h" ! 412: 1 00000000 ! 413: 2 00000000 ! 414: 3 00000000 ! 415: 4 00000000 ! 416: 5 00000000 ! 417: 6 00000000 ! 418: 7 00000000 ! 419: 8 00000000 .set SBR,0 ! 420: 9 00000000 .set SLR,1 ! 421: 10 00000000 .set P0BR,2 ! 422: 11 00000000 .set P0LR,3 ! 423: 12 00000000 .set P1BR,4 ! 424: 13 00000000 .set P1LR,5 ! 425: 14 00000000 .set P2BR,6 ! 426: 15 00000000 .set P2LR,7 ! 427: 16 00000000 .set IPL,8 ! 428: 17 00000000 .set MME,9 ! 429: 18 00000000 .set TBIA,10 ! 430: 19 00000000 ! 431: 20 00000000 .set TBIS,11 ! 432: 21 00000000 ! 433: 22 00000000 .set DCK,12 ! 434: 23 00000000 .set CCK,13 ! 435: 24 00000000 ! 436: 25 00000000 ! 437: 26 00000000 .set PCBB,14 ! 438: 27 00000000 .set ISP,15 ! 439: 28 00000000 .set SIRR,16 ! 440: 29 00000000 .set SISR,17 ! 441: 30 00000000 .set SCBB,18 ! 442: 31 00000000 .set KSP,19 ! 443: 32 00000000 .set USP,20 ! 444: 33 00000000 .set DCB,21 ! 445: 34 00000000 .set PACC,23 ! 446: 35 00000000 ! 447: 36 00000000 .set P1DC,24 ! 448: 37 00000000 .set PADC,25 ! 449: 38 00000000 ! 450: 39 00000000 .set HISR,26 ! 451: 40 00000000 .set DCR,27 ! 452: 41 00000000 .set PDCS,28 ! 453: 42 00000000 # 410 "" ! 454: 410 00000000 ! 455: 411 00000000 ! 456: 412 00000000 ! 457: 413 00000000 # 1 "./psl.h" ! 458: 1 00000000 ! 459: 2 00000000 ! 460: 3 00000000 ! 461: 4 00000000 ! 462: 5 00000000 ! 463: 6 00000000 ! 464: 7 00000000 ! 465: 8 00000000 ! 466: 9 00000000 ! 467: 10 00000000 ! 468: 11 00000000 ! 469: 12 00000000 ! 470: 13 00000000 ! 471: 14 00000000 ! 472: 15 00000000 ! 473: 16 00000000 ! 474: 17 00000000 ! 475: 18 00000000 ! 476: 19 00000000 ! 477: 20 00000000 ! 478: 21 00000000 ! 479: 22 00000000 ! 480: 23 00000000 ! 481: 24 00000000 ! 482: 25 00000000 ! 483: 26 00000000 # 413 "" ! 484: 413 00000000 ! 485: 414 00000000 ! 486: 415 00000000 ! 487: 416 00000000 # 1 "./pte.h" ! 488: 1 00000000 ! 489: 2 00000000 ! 490: 3 00000000 ! 491: 4 00000000 ! 492: 5 00000000 ! 493: 6 00000000 ! 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863: 125 00000800 .globl SSR ! 864: 126 00000800 .set SSR,0x40C #Software interrupt summary ! 865: 127 00000800 ! 866: 128 00000800 .globl HSR ! 867: 129 00000800 .set HSR,0x410 #Hardware interrupt summary ! 868: 130 00000800 ! 869: 131 00000800 .set SBB,0x414 #Pointer to system control block base ! 870: 132 00000800 .set TBCR,0x418 #Current value of hardware TBCR ! 871: 133 00000800 .set CPMDCB,0x420 #pointer to CP master DCB ! 872: 134 00000800 .set CPCTL,0x424 #CPU control word ! 873: 135 00000800 .set CPREQ,0x428 #CPU request ! 874: 136 00000800 .set CPRUN,0x42C #CPU run status (8 = step mode) ! 875: 137 00000800 .set CPRSW,0x430 #CP interrupt request word ! 876: 138 00000800 .set PSL,0x434 #Software Process Status Longword ! 877: 139 00000800 .set TVAPR,0x5E8 #saved vapr register ! 878: 140 00000800 .set TRA,0x5EC # ! 879: 141 00000800 .set TLSP,0x5F0 # ! 880: 142 00000800 .set TIAR,0x5F4 # ! 881: 143 00000800 .set TLIA,0x5F8 # ! 882: 144 00000800 .set TQ,0x5FC # ! 883: 145 00000800 .set TR0,0x600 #decellerated processor registers ! 884: 146 00000800 .set TR1,0x604 #decellerated processor registers ! 885: 147 00000800 .set TR2,0x608 #decellerated processor registers ! 886: 148 00000800 .set TR3,0x60C #decellerated processor registers ! 887: 149 00000800 .set TR4,0x610 #decellerated processor registers ! 888: 150 00000800 .set TR5,0x614 #decellerated processor registers ! 889: 151 00000800 .set TR6,0x618 #decellerated processor registers ! 890: 152 00000800 .set TR7,0x61C #decellerated processor registers ! 891: 153 00000800 .set TR8,0x620 #decellerated processor registers ! 892: 154 00000800 .set TR9,0x624 #decellerated processor registers ! 893: 155 00000800 .set TR10,0x628 #decellerated processor registers ! 894: 156 00000800 .set TR11,0x62C #decellerated processor registers ! 895: 157 00000800 .set TR12,0x630 #decellerated processor registers ! 896: 158 00000800 .set TR13,0x634 #decellerated processor registers ! 897: 159 00000800 .set TR14,0x638 #decellerated processor registers ! 898: 160 00000800 .set TR15,0x63C #decellerated processor registers ! 899: 161 00000800 .set TPC,0x640 #decellerated program counter ! 900: 162 00000800 .set TPSL,0x644 #decellerated process status longword ! 901: 163 00000800 .set TSP,0x648 #decellerated stack pointer ! 902: 164 00000800 .set TKSP,0x64C #decellerated kernel stack pointer ! 903: 165 00000800 .set TUSP,0x650 #decellerated user stack pointer ! 904: 166 00000800 .globl TCCK ! 905: 167 00000800 .set TCCK,0x654 #decellerated Code cache key ! 906: 168 00000800 .globl TDCK ! 907: 169 00000800 .set TDCK,0x658 #decellerated data cache key ! 908: 170 00000800 .set TTBK,0x65C #decellerated translation buffer key ! 909: 171 00000800 .set TSBR,0x660 #decellerated System Base Register ! 910: 172 00000800 .set TSLR,0x664 #decellerated System length register ! 911: 173 00000800 .set TP0BR,0x668 #decellerated P0 base register ! 912: 174 00000800 .set TP0LR,0x66C #decellerated P0 length register ! 913: 175 00000800 .set TP1BR,0x670 #decellerated P1 base register ! 914: 176 00000800 .set TP1LR,0x674 #decellerated P1 length register ! 915: 177 00000800 .set TP2BR,0x678 #decellerated P2 base register ! 916: 178 00000800 .set TP2LR,0x67C #decellerated P1 length register ! 917: 179 00000800 .set TIPL,0x680 #decellerated Interrupt priority level ! 918: 180 00000800 .set TMME,0x684 #decellerated Memory management enable ! 919: 181 00000800 .set TTBIA,0x68C #decellerated translation buffer invalid ! 920: 182 00000800 .set TTBIS,0x68C #decellerated transl buffer invalid single ! 921: 183 00000800 .set TPCBB,0x690 #decellerated Process control block base ! 922: 184 00000800 .set TISP,0x694 #decellerated Interrupt stack pointer ! 923: 185 00000800 .set TSIRR,0x698 #decellerated Software interrupt request ! 924: 186 00000800 .set TSISR,0x69C #decellerated Software interrupt summary ! 925: 187 00000800 .set TSCBB,0x6A0 #decellerated System control block base ! 926: 188 00000800 .set TP1CC,0x6A4 #decellerated ! 927: 189 00000800 .set TPACC,0x6A8 #decellerated ! 928: 190 00000800 .set TP1DC,0x6AC #decellerated ! 929: 191 00000800 .set TPADC,0x6B0 #decellerated ! 930: 192 00000800 .set TCPMDCB,0x6B4 #decellerated address of master DCB ! 931: 193 00000800 .set PROBFLG,0x6B8 #decellerated ! 932: 194 00000800 .set INEXCFLG,0x6BC #decellerated ! 933: 195 00000800 .set PCTYPFLG,0x6C0 # ! 934: 196 00000800 .set NOOFPARS,0x6C4 # ! 935: 197 00000800 .set STKPAR1,0x6C8 # ! 936: 198 00000800 .set STKPAR2,0x6CC # ! 937: 199 00000800 .set JMPVEC,0x6D0 # ! 938: 200 00000800 .set PSEND,0x7FC # ! 939: 201 00000800 # 443 "" ! 940: 443 00000800 ! 941: 444 00000800 .globl _Entry ! 942: 445 00000800 _Entry: ! 943: 446 00000800 71 ef0000a2f8 jmp start ! 944: 447 00000806 **** .space (1024-6) ! 945: 448 00000C00 ! 946: 449 00000C00 ! 947: 450 00000C00 ! 948: 451 00000C00 ! 949: 452 00000C00 ! 950: 453 00000C00 ! 951: 454 00000C00 ! 952: 455 00000C00 .set NLWU,35 ! 953: 456 00000C00 ! 954: 457 00000C00 ! 955: 458 00000C00 ! 956: 459 00000C00 ! 957: 460 00000C00 ! 958: 461 00000C00 .globl _restart ! 959: 462 00000C00 _restart: ! 960: 463 00000C00 **** .space 4 ! 961: 464 00000C04 ! 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